Amd pourrait résoudre les problèmes de mémoire d'Epyc Rome avec un interposeur

AMD a renoué avec la compétitivité sur le marché des datacenters avec ses processeurs métier EPYC, qui sont des modules de quatre baies Zeppelin à 8 cœurs maximum. Chaque baie possède son propre pont nord intégré, qui contrôle la mémoire DDR4 à 2 canaux et un complexe racine PCI-Express gen 3.0 à 32 voies. Dans les applications qui nécessitent une utilisation intensive de la bande passante mémoire, cette approche de la mémoire non localisée présente des goulots d'étranglement de conception qui seraient résolus dans la nouvelle Rome.

AMD EPYC Rome aurait une conception de mémoire monolithique

La famille de processeurs Ryzen Threadripper WX accentue bon nombre de ces goulots d'étranglement; dans le cas des applications d'encodage vidéo qui nécessitent beaucoup de mémoire, les baisses de performances sont considérées comme des tableaux sans accès direct aux E / S. de bande de mémoire. La solution d'AMD à ce problème consiste à concevoir les puces CPU avec un Northbridge désactivé. Cette solution pourrait être implémentée dans ses processeurs EPYC de deuxième génération, de nom de code " Rome ".

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Les MCM de nouvelle génération d'AMD pourraient voir une conception de contrôleur de système centralisé entourée de matrices, qui pourraient toutes être dans un interposeur en silicium, le même type que celui des GPU Vega 10 et Fidji. Un interposeur est une matrice de silicium qui facilite le câblage microscopique haute densité entre les matrices d'un MCM. Contrairement aux processeurs EPYC de génération actuelle, cette interface mémoire est vraiment monolithique, tout comme l'implémentation Intel.

Le contrôleur système dispose également d'une racine complexe PCI-Express gen 4.0 x96, qui peut gérer jusqu'à six cartes graphiques à bande passante x16, ou jusqu'à douze sur x8. La matrice intègre également le Southbridge, connu sous le nom de Server Controller Hub, qui implémente des interfaces d'E / S courantes telles que SATA, USB et d'autres E / S héritées à faible bande passante, en plus de quelques autres lignes PCIe.

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