Epyc Milan et Gênes, AMD donne des détails sur son nouveau processeur de serveur

AMD a révélé quelques détails sur l' architecture EPYC Milan (Zen 3) et l'architecture EPYC Genoa (Zen 4) prévues par l'entreprise.

EPYC Milan et Gênes, AMD donne des détails sur ses nouveaux processeurs de serveur

Au cours de sa présentation, Martin Hilgeman d'AMD, directeur principal des applications HPC, a révélé des diapositives confirmant que la prochaine série de processeurs EPYC 'Milan' sera lancée sur le socket serveur SP3 existant d'AMD, prendra en charge la mémoire DDR4 et proposera le même TDP les mêmes configurations de base que la série de processeurs Rome.

Cette diapositive semble dissiper les rumeurs selon lesquelles AMD prévoyait de lancer Milan avec une implémentation 4x SMT, qui affirmait que Zen 3 offrirait aux utilisateurs quatre threads par cœur de processeur. Il semble que la principale source d'amélioration des performances de Zen 3 proviendra des améliorations de l'IPC et des gains de vitesse d'horloge, plutôt que des augmentations du nombre de cœurs et de threads. Espérons que cela signifie que Zen 3 se concentrera sur les performances `` monocœur '' et les améliorations de l'architecture de base.

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En ce qui concerne EPYC Genoa (Zen 4), Helgeman affirme que Zen 4 est encore en phase de conception, ce qui signifie que les fabricants de serveurs et d'autres clients ont la possibilité d'influencer la conception de Gênes. Il est également confirmé que cette nouvelle architecture sera lancée avec un nouveau socket SP5, supportera un nouveau type de mémoire (probablement DDR5) et offrira aux utilisateurs de "nouvelles capacités", qui n'ont pas été révélées.

Internalisant la conception de Zen 3, AMD a confirmé que Zen 3 s'éloignerait de la conception de cache divisé de Zen / Zen 2, qui divisait le cache CPU L3 d'AMD entre deux CCX quadricœurs. Cela signifie qu'AMD pourrait s'éloigner de sa propre conception CCX à quatre cœurs, créant une conception CCX à huit cœurs avec Zen 3 ou une conception différente.

Plutôt que d'offrir deux caches L3 de 16 Mo (comme le montre la conception actuelle d'AMD Zen 2), la conception Zen 3 d' AMD offrira une combinaison de cache L3 «32 + Mo» sur les huit cœurs de processeur. Cela réduira les latences potentielles entre les cœurs de processeur dans un seul dé et garantira un meilleur accès au cache L3 intégré pour les cœurs de processeur. De plus, ce cache serait plus grand que la vue des générations précédentes.

EPYC Milan viendrait à nous au cours du second semestre 2020.

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