Intel annonce un nouveau lac en cascade xeon avec jusqu'à 48 cœurs

Intel a annoncé la prochaine famille de processeurs Xeon Cascade Lake qu'il prévoit de lancer au cours du premier semestre de l'année prochaine. Les nouvelles pièces représentent une amélioration substantielle, avec jusqu'à 48 cœurs et 12 canaux de mémoire DDR4 par socket, prenant en charge jusqu'à deux sockets.

Intel Xeon Cascade Lake aura une conception non monolithique

Ces processeurs de Cascade Lake offrent un niveau de performances plus élevé que les processeurs évolutifs (SP) de Xeon. Les puces Xeon SP d'aujourd'hui utilisent une matrice monolithique, avec jusqu'à 28 cœurs et 56 threads. Au lieu de cela, Cascade Lake AP sera un processeur multi-puces avec plusieurs puces dans un seul paquet. AMD utilise une approche similaire pour ses produits comparables, les processeurs EPYC utilisant quatre matrices dans chaque boîtier.

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Le passage à une conception multi-puces est probable car, à mesure que les baies deviennent de plus en plus grandes, elles sont plus susceptibles de contenir un défaut. L'utilisation de plusieurs matrices plus petites permet d'éviter ces défauts. Étant donné que le processus de fabrication d'Intel à 10 nm n'est toujours pas assez bon pour la production sur le marché de masse, les nouveaux Xeons continueront d'utiliser une version du processus à 14 nm de l'entreprise. L'énorme quantité de canaux de mémoire nécessitera une énorme prise, qui est actuellement considérée comme un connecteur à 5903 broches.

En particulier, Intel répertorie un seul nombre de cœurs pour ces processeurs, plutôt que la combinaison habituelle de nombre de cœurs et de threads. Il n'est pas clair si cela signifie que les nouveaux processeurs n'auront pas HT, ou si l'entreprise préfère mettre l'accent sur les cœurs physiques et éviter certains des problèmes de sécurité que HT peut présenter dans certains scénarios d'utilisation.

Dans l'ensemble, la société revendique une amélioration des performances de 20% par rapport aux SP Xeon actuels et de 240% par rapport à l'EPYC d'AMD, avec des gains plus élevés de charges de travail nécessitant une utilisation intensive de la bande passante. mémoire. Les nouveaux processeurs comprendront une série de nouvelles instructions AVX512 conçues pour améliorer les performances des réseaux de neurones fonctionnels.

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